从零开始学CPLD和Verilog HDL编程技术

图书标准信息

• 作者 刘汉文、高广海 著；刘建清 编
• 出版社 国防工业出版社
• 出版时间 2006-08
• 版次 1
• ISBN 9787118046090
• 定价 30.00元
• 装帧 平装
• 开本 16开
• 纸张 胶版纸
• 页数 254页
• 字数 376千字
• 丛书 从零开始学电子技术丛书

【内容简介】

CPLD（复杂可编程逻辑器件）在数字电子技术领域中的应用越来越广泛，尤其适合于新产品的开发与小批量生产，因此深受广大工程技术人员喜爱。
《从零开始学CPLD和VerilogHDL编程技术》定位于让初学者从零起步，轻松学会CPLD的系统设计技术。本书以ALTERA公司的系列芯片为目标载体，简要分析了可编程逻辑器件的结构和特点，以及相应开发软件的使用方法，同时，还用大量篇幅介绍了初学者最容易掌握的VerilogHDL硬件描述语言。本书完全以实战为主，通过实践的方法帮助读者加深理解CPLD的基本知识。
本书附赠光盘一张，光盘中包含了书中所有实验的源程序。
《从零开始学CPLD和VerilogHDL编程技术》可供从事各类电子系统设计的广大工程技术人员以及电子爱好者阅读，也可作为电子类专业的教材或教学参考书使用。

【目录】

第一章CPLD与FPGA概述
第一节可编程逻辑器件的发展及特点
一、可编程逻辑器件的发展
二、CPLD／FGPA的用途
三、CPLD／FPGA的特点
四、CPLD与FPGA的比较
五、CPLD／FPGA和单片机的比较
第二节CPLD／FPGA的基本工作原理
一、基于乘积项的CPLD的工作原理
二、采用查找表的FPGA的工作原理
第三节Altera系列CPLD介绍
一、MAX7000系列器件简介
二、MAX7000系列器件的结构
三、MAX7000系列器件功能描述
第四节Xilinx系列CPLD介绍
一、XC9500系列器件简介
二、XC9500系列器件的结构
三、XC9500系列器件功能描述
第五节可编程逻辑器件的开发
一、可编程逻辑器件的设计过程
二、可编程逻辑器件设计举例
第二章CPLD实验仪介绍
第一节DP-MCU／Altera实验仪
一、实验仪主要器件
二、应用接口
三、跳线接口
四、原理简介
第二节DP—MCU／Xilinx实验仪
一、实验仪主要器件
二、应用接口
三、跳线接口
四、原理简介
第三节其他CPLD实验仪
一、CPLDMCU下载仿真实验仪
二、AlteraCPLD开发板
三、5l+CPLD学习板
第三章CPLD开发软件和仿真软件的使用
第一节Altera开发软件MAX+plusII的安装和使用
一、MAX+plusII的安装
二、MAX+plusII的使用
第二节Xmnx开发软件ISEWebPACK的安装和使用
一、WebPACK软件的安装
二、WebPACK软件的使用
第三节仿真ModelsimSE软件的安装和使用
一、ModelsimSE6．0软件的安装
二、ModelsimSE6．0软件的使用
第四章初识VerilogHDL
第一节硬件描述语言概述
一、什么是硬件描述语言
二、硬件描述语言的发展
三、为何使用硬件描述语言
第二节VerilogHDL基本知识
一、什么是VerilogHDL
二、VerilogHDL的发展
三、VerilogHDL与VHDL比较
四、VerilogHDL与C语言的比较
第三节VerilogHDL模块介绍
一、什么是模块
二、模块的结构
第五章VerilogHDL数据类型与运算符
第一节VerilogHDL基本词法
一、标识符
二、关键字
三、注释
四、空白符
第二节VerilogHDL常量变量及其数据类型
一、常量及其数据类型
二、变量及其数据类型
第三节VerilogHDL运算符
一、算术运算符
二、逻辑运算符
三、位运算符
四、关系运算符
五、等式运算符
六、缩位运算符
七、移位运算符
八、条件运算符
九、位拼接运算符
第六章VerilogHDL基本语句
第一节赋值语句
一、持续赋值语句
二、过程赋值语句
第二节块语句
一、串行块语句beginIend
二、并行块语句fork-join
第三节过程语句
一、initial过程语句
二、always过程语句
第四节条件语句
一、if条件语句
二、case条件语句
第五节循环语句
一、forever语句
二、repeat语句
三、while语句
四、for语句
第六节编译向导语句
一、宏替换define
二、文件包舍include
三、条件编译ifdef、else、endif
四、时间尺度timescale
第七节任务(task)和函数(function)说明语句
一、任务(task)说明语句
二、函数(function)说明语句
第八节系统任务与系统函数
一、$display和$write任务
二、$monitor与$strobe
三、$time与$realtime
四、$finish与$stop
第七章VerilogHDL的描述方式
第一节结构描述方式
一、VerilogHDL内置门元件
二、门级结构描述
第二节数据流描述方式
第三节行为描述方式
第八章用VerilogHDL描述数字电路
第一节基本门电路的设计
一、与门
二、或门
三、非门
四、与非门
五、或非门
六、异或门
七、缓冲门
八、三态门
第二节组合逻辑电路的设计
一、数据选择器
二、编码器
三、译码器
四、加法器
第三节双稳态触发器的设计
一、RS触发器
二、D触发器
三、JK触发器
四、T触发器
第四节时序逻辑电路的设计
一、寄存器
二、锁存器
三、计数器
第九章CPLD实验与综合设计实例
第一节CPLD基本实验
一、LED发光二极管实验
二、键盘实验
三、数码LED显示器实验
四、音响实验
第二节CPLD综合设计实例
一、乐曲演奏电路
二、数字钟
三、频率计
四、交通灯
参考文献