EDA与数字系统设计案例实践
￥ 18.65 5.3折 ￥ 35 九五品
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作者黄科 著
出版社清华大学出版社
ISBN9787302214014
出版时间2010-01
版次1
装帧平装
开本16开
纸张胶版纸
页数346页
字数99999千字
定价35元
上书时间2024-06-30
商品详情
- 品相描述：九五品
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基本信息
书名:EDA与数字系统设计案例实践
定价：35元
作者:黄科 著
出版社：清华大学出版社
出版日期：2010-01-01
ISBN：9787302214014
字数：501000
页码：346
版次：1
装帧：平装
开本：16开
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内容提要
《EDA数字系统设计案例实践》采用电子设计自动化（EDA）的设计思想与方法对数字电子系统中的关键电路和实用电路 进行分析与设计。各设计实例都从原理叙述和逻辑分析出发，然后采用EDA方式进行设计输入、设计仿真和具体实现。全书共8章，内容包括组合逻辑电路中的码制转换器、数值比较器，算术运算电路、时序逻辑电路中的计数器、串并／并串转换器、序列发生器和序列检测器，以及综合实用的电子钟电路。附录介绍了4种EDA常用的工具软件。 各章在具体内容的选择上，力求体现综合性、实用性与技术先进性。在每一实例之后，还提供用于相关设计的课题。读者通过设计实例的学习和研究，可开拓视野，掌握电子与数字系统设计的一般方法与技巧。 《EDA数字系统设计案例实践》主要面向有一定数字电路和EDA基础的读者，但详细的数字逻辑推导，让初学者也能舒畅的阅读《EDA数字系统设计案例实践》。而且所有设计过程详细，是一本适合EDA快速入门的书籍。
目录
章 码制转换器设计1.1 格雷码与BCD码1.1.1 格雷码简述1.1.2 BCD码简述1.2 方案设计与论证1.2.1 格雷码转换为自然二进制码的方案设计与论证1.2.2 自然二进制码转换为8421BCD码的方案设计与论证1.3 原理图逻辑设计1.3.1 设计逻辑电路图1.3.2 原理图逻辑输入及仿真测试1.4 VHDL硬件描述语言设计1.4.1 设计方案论证1.4.2 硬件描述语言设计输入方法1.5 总结1.6 相关设计课题课题1：自然二进制码到格雷码转换器的设计与实现课题2：8421BCD码到其他BCD码的转换电路设计1.7 参考文献第2章 数值比较器设计2.1 引言2.2 数值比较器的设计原理2.3 原理图逻辑设计2.3.1 设计逻辑电路图2.3.2 原理图逻辑输入及仿真测试2.4 VHDL硬件描述语言设计2.4.1 一位数值比较器的硬件描述语言设计2.4.2 不带扩展端的四位数值比较器的硬件描述语言设计2.4.3 带扩展位的四位数值比较器的硬件描述语言设计2.5 总结2.6 相关设计课题课题1：六位数值比较器的设计课题2：六十四位数值比较器的设计2.7 参考文献第3章 算术电路设计3.1 引言3.2 加法器的设计3.2.1 原理图逻辑设计3.2.2 VHDL硬件描述语言设计3.3 乘法器的设计3.3.1 原理图逻辑设计3.3.2 VHDL硬件描述语言设计3.4 总结3.5 相关设计课题课题1：十六位加法器的设计课题2：八位乘法器的设计3.6 参考文献第4章 2421 BCD码十进制递增计数器设计4.1 引言4.2 系统总体设计4.2.1 系统方案设计4.2.2 设计方式和设计步骤4.3 原理图逻辑设计4.3.1 设计逻辑电路图4.3.2 原理图逻辑输入及仿真测试4.4 VHDL硬件描述语言设计4.4.1 计数器硬件描述语言设计方案论证4.4.2 计数器硬件描述语言设计输入方法4.5 总结4.6 相关设计课题课题1：双模递增计数器的设计课题2：具有异步清零、同步置数功能的同步8421BCD码十进制计数器设计课题3：具有异步清零、同步可逆功能的四位二进制计数器设计4.7 参考文献第5章 串并/并串转铁器 设计第6章 序列发生器的设计第7章 序列检测器的设计第8章 电子钟电路设计附录A ispDesignEXPERT开发软件附录B ISE开发软件附录C ModelSim开发软件附录D MAX+PLUSII开发软件
作者介绍
根据多位数比较的规则，在高位相等时才取决于低位的比较结果，因而在对超过四位的数据进行比较时，只需将两个带扩展的四位数值比较进行联接处理即可得到，如要得到一个八位数值比较器，只需将两个八位数据的高四位接在第二个四位数值比较器上，低四位接在第一个四位比较器上即可。当高四位不相等时，则其输入结果即为实际的八位数值的比较结果，如果高四位相等，此时再对低四位的比较结果进行综合，得到最后的输出结果。 对带扩展端的四位数值比较器的扩展方式有串联和并联两种。图2.6所示即为两个4位数值比较器串联而成一个8位数值比较器。在高位相等时取决于低位的比较结果。由四位比较器的扩展端可知只有在两个输入的四位数相等时。 ……
序言
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【封面】
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