EDA技术与Verilog HDL
￥ 14.23 2.1折 ￥ 69 九五品
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天津武清
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作者王金明
出版社清华大学出版社
ISBN9787302574323
出版时间2021-04
版次1
装帧平装
开本16开
纸张胶版纸
定价69元
上书时间2024-05-06
商品详情
- 品相描述：九五品
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基本信息
书名:EDA技术与Verilog HDL
定价：69.00元
作者:王金明
出版社：清华大学出版社
出版日期：2021-04-01
ISBN：9787302574323
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版次：
装帧：平装
开本：16开
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编辑推荐
（1） 按“器件—软件—语言—案例”展开，内容由浅入深，举例恰当丰富，富有启发性。（2） 以Vivado、ModelSim典型软件为工具，以Verilog-1995和Verilog-2001两个语言标准为依据，以应用为驱动，从具体案例到一般方法，由浅入深阐述数字设计的思想与方法。（3） 注重实践能力和创新能力培养，讲解通俗易懂，以EGO1“口袋实验板”作为目标板，架设从理论到工程实践的桥梁，便于自主学习和实验验证。（4） 设计案例经过优选，具有典型性和趣味性，便于基于案例或者基于情景导向的教学模式的实施。（5） 提供电子教学课件和设计源代码。
内容提要
本书根据EDA课程教学要求，以提高数字设计能力为目标，系统阐述FPGA设计开发的相关知识，主要内容包括EDA技术概述、FPGA/CPLD器件结构、Verilog硬件描述语言及设计案例等。全书以Vivado、ModelSim软件为工具，以Verilog-1995和Verilog-2001标准为依据，以可综合的设计为重点，以EGO1“口袋实验板”作为目标板，通过诸多精选设计案例，系统阐述数字系统设计方法与设计思想，由浅入深地介绍Verilog工程开发的手段与技能。 本书可作为电子、通信、微电子、信息、电路与系统、通信与信息系统及测控技术与仪器等专业本科生和研究生的教学用书，也可供从事电路设计和系统开发的工程技术人员阅读参考。
目录
章EDA技术概述1.1EDA技术及其发展1.2Topdown设计与IP核复用1.2.1Topdown设计1.2.2Bottomup设计1.2.3IP复用技术与SoC1.3EDA设计的流程1.3.1设计输入1.3.2综合1.3.3布局布线1.3.4时序分析与时序约束1.3.5功能仿真与时序仿真1.3.6编程与配置1.4常用的EDA工具软件1.5EDA技术的发展趋势习题1第2章FPGA/CPLD2.1PLD概述2.1.1PLD的发展历程2.1.2PLD的分类2.2PLD的基本原理与结构2.2.1PLD的基本结构2.2.2PLD电路的表示方法2.3低密度PLD的原理与结构2.4CPLD的原理与结构2.4.1宏单元结构2.4.2CPLD的结构2.5FPGA的原理与结构2.5.1查找表结构2.5.2FPGA的结构2.5.3Artix7系列FPGA2.6FPGA/CPLD的编程元件2.7边界扫描测试技术2.8FPGA/CPLD的编程与配置2.8.1在系统可编程2.8.2Artix7器件的配置2.9Xilinx的FPGA器件2.10FPGA/CPLD的发展趋势习题2第3章Vivado使用指南3.1Vivado流水灯设计3.1.1流水灯设计输入3.1.2行为仿真3.1.3综合与引脚的约束3.1.4生成比特流文件并下载3.1.5将配置数据烧写至Flash中3.2IP核的创建和封装3.3基于IP集成的计数器设计3.4Vivado的综合策略与优化设置习题3第4章Verilog语言初步4.1Verilog模块的结构4.2Verilog基本电路设计4.2.1Verilog组合电路设计4.2.2Verilog时序电路设计4.3Verilog语言要素4.4常量4.4.1整数4.4.2实数4.4.3字符串4.5数据类型4.5.1net型4.5.2variable型4.6参数4.6.1参数parameter4.6.2Verilog2001中的参数声明4.6.3参数的传递4.6.4关键字localparam4.7向量4.8运算符习题4第5章Verilog语句语法5.1过程语句5.1.1always过程语句5.1.2initial过程语句5.2块语句5.2.1串行块beginend5.2.2并行块forkjoin5.3赋值语句5.3.1持续赋值与过程赋值5.3.2阻塞赋值与非阻塞赋值5.4条件语句5.4.1ifelse语句5.4.2case语句5.5循环语句5.5.1for语句5.5.2repeat、while、forever语句5.6编译指示语句5.7任务与函数5.7.1任务5.7.2函数5.8Verilog2001语言标准5.8.1Verilog2001改进和增强的语法结构5.8.2属性及PLI接口习题5第6章Verilog设计的层次与风格6.1Verilog设计的层次6.2门级结构描述6.2.1Verilog门元件6.2.2门级结构描述6.3数据流描述与行为描述6.4不同描述风格的设计6.4.1半加器设计6.4.21位全加器设计6.4.3加法器的级联6.5多层次结构电路的设计6.5.1模块例化6.5.2用parameter进行参数传递6.5.3用defparam进行参数重载6.6Verilog组合逻辑设计6.7Verilog时序逻辑设计6.8三态逻辑设计习题6第7章Verilog有限状态机设计7.1有限状态机7.2有限状态机的Verilog描述7.2.1用三个always块描述7.2.2用两个过程描述7.2.3单过程描述方式7.3状态编码7.3.1常用的编码方式7.3.2状态编码的定义7.4有限状态机设计要点7.4.1复位和起始状态的选择7.4.2多余状态的处理7.5有限状态机应用实例7.5.1用有限状态机控制彩灯7.5.2用有限状态机控制A/D采样习题7第8章Verilog驱动常用I/O外设8.14×4矩阵键盘8.2数码管8.3标准PS/2键盘8.4字符液晶8.5汉字图形点阵液晶8.6VGA显示器8.6.1VGA显示原理与时序8.6.2VGA彩条信号发生器8.6.3VGA图像显示与控制8.7乐曲演奏电路习题8第9章Verilog设计进阶9.1设计的可综合性9.2流水线设计技术9.3资源共享9.4阻塞赋值与非阻塞赋值9.5加法器设计9.5.1行波进位加法器9.5.2超前进位加法器9.5.3流水线加法器9.6乘法器设计9.6.1并行乘法器9.6.2布斯乘法器9.6.3查找表乘法器9.7奇数分频与小数分频9.7.1奇数分频9.7.2半整数分频9.7.3小数分频习题90章Verilog设计实例10.1脉宽调制与步进电动机驱动10.1.1PWM信号10.1.2用PWM驱动蜂鸣器10.1.3用PWM驱动步进电动机10.2超声波测距10.3整数开方运算10.4频率测量10.5Cordic算法及其实现10.5.1Cordic算法原理10.5.2Cordic算法的实现10.6UART异步串口通信10.7蓝牙通信10.8用XADC实现模/数转换10.8.17系列FPGA片内集成ADC概述10.8.2XADC的使用习题101章Verilog Test Bench仿真11.1系统任务与系统函数11.2用户自定义元件11.2.1组合电路UDP元件11.2.2时序逻辑UDP元件11.3延时模型的表示11.3.1时间标尺定义`timescale11.3.2延时的表示与延时说明块11.4测试平台11.5组合和时序电路的仿真11.6ModelSim SE仿真实例11.6.1图形界面进行功能仿真11.6.2命令行方式进行功能仿真11.6.3时序仿真习题11附录AVerilog HDL(IEEE Std 1364)关键字附录BEGO1开发板参考文献
作者介绍
王金明，博士，陆军工程大学副教授、硕导。2013年获军队院校育才奖银奖；2014年由国家留学基金委资助，在美国威斯康星大学麦迪逊分校访学1年。曾获军队级教学成果二等奖1项；获军队科技进步一等奖1项，军队科技进步二等奖3项，军队科技进步三等奖5项。获国家发明专利授权2项，获软件著作授权1项；发表论文60余篇，其中SCI、EI收录30余篇。主编教材多部，其中《EDA技术与VHDL设计》（~2版）入选“十一五”规划教材和“十二五”规划教材，《数字系统设计与Verilog HDL》（~7版）发行近20万册。指导本科生参加全国大学生电子设计竞赛，获全国一等奖、二等奖多项。
序言
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【封面】
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