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systemverilog数字集成电路功能验证大中专理科计算机王旭编

数字集成电路验证工程师的语法参手册

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北京丰台

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作者王旭编

出版社人民邮电出版社

ISBN9787115614056

出版时间2023-09

版次1

装帧平装

开本16

页数332页

字数497千字

定价79.8元

货号732_9787115614056

上书时间2024-11-25

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商品详情

品相描述：全新: 正版特价新书

商品描述: 主编：

本书由深信息名师与企业联合编写，教材注重实践能力的培养，案例丰富，理论知识讲解以实用为主。ytemverilog是当前外被广泛使用的数字集成电路验证语言，它可以高效地对被测设计进行受约束的测试，从而在尽可能短的时间内达到令人满意的代码覆盖率和功能覆盖率。熟练掌握 ytemverilog语言是进一步学uvm 验证方法学的基础。本书适合作为高等院校集成电路、微电子、计算机相关专业的教材，同时适用于具有verilog编程基础的人员参使用，也可以作为数字集成电路验证工程师的语法参手册。

目录：

前言

章验证导论

1.1芯片设计流程

1.2功能验证与测试台

1.3验证流程

1.4验证语言和验证方法学

1.5定向测试和受约束测试

1.6层次化测试台

1.7层次化测试台的执行

1.8练题

第2章测试台和数据类型

2.1测试台

2.1.1被测设计

2.1.2测试模块

2.1.3测试台项层模块

2.2基本数据类型

……

内容简介：

ytemverilog是当前外被广泛使用的数字集成电路验证语言，它可以高效地对被测设计进行受约束的测试，从而在尽可能短的时间内达到令人满意的代码和功能覆盖率。熟练掌握ytemverilog语言是进一步学uvm验证方法学的基础。本书比较全面地讲解了ytemverilog语言和面向对象编程。讲述的语言内容主要包括数据类型、接、面向对象编程、化、约束、进程同步、功能覆盖和dpi技术等。在介绍面向对象编程时，详细说明了类、对象、句柄和构造方法之间的相互关系，并重点讲解了继承、派生、多态、复制方法、静态属、静态方法和单例类等关键技术。为了更好地衔接后续uvm的学，本书还使用ytemverilog实现了uvm中的配置数据库、测试登记表、代理类和工厂机制(包括重写功能)。通过阅读本书中的简化uvm代码，读者可以更快速清晰地理解uvm常用机制的底层实现，为接下来系统学uvm验证方法学打下坚实的基础。为了方便读者学和练，本书的配套资源中提供了书中完整实例。第9章是本书的内容，这一章仿照uvm的工作过程，从零开始逐步搭建出一个支持工厂机制、带有覆盖收集和回调功能的受约束测试台。读者通过反复阅读、改写和调试这个测试台，可以更全面地理解面向对象编程的关键技术和uvm的常用机制。本书适合作为高等院校集成电路、微电子、计算机相关专业的教材，同时适用于具有verilog编程基础的人员参使用，也可以作为数字集成电路验证工程师的语法参手册。

作者简介：

王旭，从事数字集成电路方面的和研发，目前在学校主要讲述集成电路验证的课程、在企业作为兼职顾问，负责为企业研发的芯片指定验证方案、验证计划。