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【95成新塑封包装已消毒】EDA技术与Verilog HDL 黄继业,陈龙,潘

【95成新塑封包装已消毒】有写过的痕迹但是笔记很少，整体很新，正版，无附件、光盘、增值服务等。

11.46 2.3折 49.8 九五品

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浙江杭州

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作者黄继业,陈龙,潘松

出版社清华大学出版社

ISBN9787302486657

出版时间2017-12

版次1

装帧平装

开本16开

纸张胶版纸

页数349页

字数99999千字

定价49.8元

货号9787302486657-1

上书时间2023-08-28

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商品详情

品相描述：九五品: 【书非常新，塑封包装，有少许笔记】但不影响阅读，无附件和增值服务等。

商品描述: 基本信息
书名:EDA技术与Verilog HDL
定价：49.80元
作者:黄继业,陈龙,潘松
出版社：清华大学出版社
出版日期：2017-12-01
ISBN：9787302486657
字数：552000
页码：349
版次：
装帧：平装
开本：16开
商品重量：
编辑推荐
本书使读者能迅速了解并掌握EDA 技术的基本理论和工程开发实用技术，为后续的深入学习和发展打下坚实的理论与实践基础。笔者依据高校课堂教学和实验操作的规律与要求，并以提高学生的实际工程设计能力和自主创新能力为目的，合理编排全书内容。书中列举的Verilog HDL 示例都经编译通过或经硬件测试通过。　　本书主要面向高等院校本、专科的EDA 技术和Verilog HDL 语言基础课，同时也可作为电子设计竞赛、FPGA 开发应用的自学参考书。与此教材配套的还有 CAI 教学课件、实验指导课件、实验源程序和实验设计项目相关的详细技术资料等，读者都可免费索取。
内容提要
本书系统地介绍了EDA 技术和Verilog HDL 硬件描述语言，将Verilog HDL 的基础知识、编程技巧和实用方法与实际工程开发技术在Quartus II 上很好地结合起来，使读者通过本书的学习能迅速了解并掌握EDA 技术的基本理论和工程开发实用技术，为后续的深入学习和发展打下坚实的理论与实践基础。　　笔者依据高校课堂教学和实验操作的规律与要求，并以提高学生的实际工程设计能力和自主创新能力为目的，合理编排全书内容。全书共分为7 个部分：EDA 技术的概述、Verilog HDL 语法知识及其实用技术、Quartus II 及LPM 宏模块的详细使用方法、有限状态机设计技术、16 位实用CPU 设计技术及创新实践项目、基于ModelSim 的Test Bench 仿真技术，以及基于MATLAB 和DSP Builder 平台的EDA 设计技术及大量实用系统设计示例。除个别章节外，大多数章节都安排了相应的习题和大量针对性强的实验与设计项目。书中列举的Verilog HDL 示例都经编译通过或经硬件测试通过。　　本书主要面向高等院校本、专科的EDA 技术和Verilog HDL 语言基础课，推荐作为电子工程、通信、工业自动化、计算机应用技术、电子对抗、仪器仪表、数字信号或图像处理等学科专业和相关实验指导课的教材用书或主要参考书，同时也可作为电子设计竞赛、FPGA 开发应用的自学参考书。与此教材配套的还有 CAI 教学课件、实验指导课件、实验源程序和实验设计项目相关的详细技术资料等，读者都可免费索取。
目录
章概述 11.1 EDA 技术 11.2 EDA 技术应用对象 21.3 常用的硬件描述语言 41.4 EDA 技术的优势 61.5 面向FPGA 和CPLD 的开发流程 71.5.1 设计输入 71.5.2 综合 81.5.3 适配（布线布局） 101.5.4 仿真 101.5.5 RTL 描述 111.6 可编程逻辑器件 111.6.1 PLD 的分类 111.6.2 PROM 可编程原理 121.6.3 GAL141.7 CPLD 的结构与可编程原理 161.8 FPGA 的结构与工作原理 181.8.1 查找表逻辑结构 181.8.2 Cyclone 4E 系列器件的结构原理 191.8.3 内嵌Flash 的FPGA 器件 221.9 硬件测试技术 221.9.1 内部逻辑测试 221.9.2 JTAG 边界扫描测试 231.10 编程与配置 231.11 Quartus II 251.12 IP 核 261.13 EDA 的发展趋势 27习题 28第2 章程序结构与数据类型 292.1 Verilog 程序结构 292.1.1 Verilog 模块的表达方式 30 2.1.2 Verilog 模块的端口信号名和端口模式 302.1.3 Verilog 信号类型定义 312.1.4 Verilog 模块功能描述 322.2 Verilog 的数据类型 322.2.1 net 网线类型 332.2.2 wire 网线型变量的定义方法 332.2.3 register 寄存器类型 342.2.4 reg 寄存器型变量的定义方法 342.2.5 integer 类型变量的定义方法 352.2.6 存储器类型 352.3 Verilog 文字规则 372.3.1 Verilog 的4 种逻辑状态 372.3.2 Verilog 的数字表达形式 372.3.3 数据类型表示方式 382.3.4 常量 . 382.3.5 标识符、关键词及其他文字规则 . 402.3.6 参数定义关键词parameter 和localparam 的用法 41习题 42第3 章行为语句 433.1 过程语句 433.1.1 always 语句 433.1.2 always 语句在D 触发器设计中的应用 453.1.3 多过程应用与异步时序电路设计 453.1.4 简单加法计数器的Verilog 表述 463.1.5 initial 语句 473.2 块语句 493.3 case 条件语句 493.4 if 条件语句 513.4.1 if 语句的一般表述形式 513.4.2 基于if 语句的组合电路设计 523.4.3 基于if 语句的时序电路设计 533.4.4 含异步复位和时钟使能的D 触发器的设计 553.4.5 含同步复位控制的D 触发器的设计 563.4.6 含清零控制的锁存器的设计 573.4.7 时钟过程表述的特点和规律 583.4.8 实用加法计数器设计 593.4.9 含同步预置功能的移位寄存器设计 61 3.4.10 关注if 语句中的条件指示 623.5 过程赋值语句 633.6 循环语句 643.6.1 for 语句 643.6.2 while 语句 653.6.3 repeat 语句 663.6.4 forever 语句 673.7 任务与函数语句 67习题 69第4 章 FPGA 硬件实现 714.1 代码编辑输入和系统编译 714.1.1 编辑和输入设计文件 714.1.2 创建工程 724.1.3 约束项目设置 734.1.4 全程综合与编译 754.1.5 RTL 图观察器应用 764.2 时序仿真测试 774.3 硬件测试 804.3.1 引脚锁定 804.3.2 编译文件下载 824.3.3 通过JTAG 口对配置芯片进行间接编程 834.3.4 USB-Blaster 驱动程序安装方法 844.4 电路原理图设计流程 854.4.1 设计一个半加器 854.4.2 完成全加器顶层设计 874.4.3 对全加器进行时序仿真和硬件测试 874.5 利用属性表述实现引脚锁定 884.6 SignalTap II 的用法 904.7 编辑SignalTap II 的触发信号 954.8 安装Quartus II 13.1 说明 95习题 100实验与设计 100实验4-1 多路选择器设计实验 100实验4-2 十六进制7 段数码显示译码器设计 101实验4-3 8 位硬件乘法器设计实验 102实验4-4 应用宏模块设计数字频率计 103实验4-5 计数器设计实验 . 107实验4-6 数码扫描显示电路设计 107实验4-7 半整数与奇数分频器设计 108第5 章运算符与结构描述语句 1105.1 运算操作符 1105.1.1 按位逻辑操作符 1105.1.2 逻辑运算操作符 1115.1.3 算术运算操作符 1115.1.4 关系运算操作符 1125.1.5 BCD 码加法器设计示例 1135.1.6 缩位操作符 1145.1.7 并位操作符 1145.1.8 移位操作符用法 1155.1.9 移位操作符用法示例 1155.1.10 条件操作符 1165.2 连续赋值语句 1175.3 例化语句 1185.3.1 半加器设计 1185.3.2 全加器设计 1195.3.3 Verilog 例化语句及其用法 1195.4 参数传递语句应用 1215.5 用库元件实现结构描述 1225.6 编译指示语句 1245.6.1 宏定义命令语句 1245.6.2 文件包含语句 'include 1255.6.3 条件编译命令语句'ifdef、'else、'endif 1255.7 keep 属性应用 1265.8 SignalProbe 使用方法 128习题 130实验与设计 131实验5-1 高速硬件除法器设计实验 131实验5-2 不同类型的移位寄存器设计实验 132实验5-3 基于Verilog 代码的频率计设计 132实验5-4 8 位加法器设计实验 133实验5-5 VGA 彩条信号显示控制电路设计 134第6 章 LPM宏模块用法 1386.1 调用计数器宏
作者介绍

序言