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  • 基于QuartusII的数字逻辑实验手册9787562964957
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基于QuartusII的数字逻辑实验手册9787562964957

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￥ 27.5 7.2折 ￥ 38 全新

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广东广州
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作者编者:栾岚|责编:雷红娟

出版社武汉理工

ISBN9787562964957

出版时间2021-10

装帧其他

开本其他

定价38元

货号31509625

上书时间2024-07-27

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品相描述：全新
商品描述
目录
实验一  集成逻辑门的逻辑功能测试以及QuartusⅡ的基本使用
  一、实验目的
  二、实验原理
  三、实验设备
  四、实验内容及实验步骤
  五、实验总结
实验二  组合逻辑电路的原理图设计
  一、实验目的
  二、实验原理
  三、实验设备
  四、实验内容及实验步骤
  五、实验总结
实验三  8-3编码器的Verilog设计与实现
  一、实验目的
  二、实验环境
  三、实验内容
  四、实验原理
  五、实验步骤
  六、实验总结
实验四  3-8译码器的Verilog 设计与应用
  一、实验目的
  二、实验环境
  三、实验内容
  四、实验原理
  五、实验步骤
  六、实验总结
实验五  数据选择器的Verilog设计及Symbol的生成
  一、实验目的
  二、实验环境
  三、实验内容
  四、实验原理
  五、实验步骤
  六、思考练习
实验六  组合逻辑电路的Verilog 设计
  一、实验目的
  二、实验环境
  三、实验内容
  四、实验步骤
  五、实验总结
实验七  D触发器的Verilog设计
  一、实验目的
  二、实验环境
  三、实验内容
  四、实验原理
  五、实验步骤
  六、实验总结
  七、思考练习
实验八  4位二进制加减法计数器的Verilog设计
  一、实验目的
  二、实验环境

内容摘要
 本书从可编程器件、
EDA软件和硬件描述语言的现代数字系统的设计方法出发，内容涵盖两大部分：QuartusⅡ的原理图设计、QuartusⅡ的文本设计。
全书共包含9个实验，分别为：集成逻辑门的逻辑功
能测试以及QuartusⅡ的基本使用、组合逻辑电路的原理图设计、8-3编码器的Verilog设计与实现、3-8译码器的Verilog设计与应用、
数据选择器的Verilog设计及Symbol的生成、组合逻辑电路的Verilog设计、D触发器的Veri-log设计、4位二进制加减法计数器的Verilog设计、基于状态机的数字系统综合设计。
本书可作为计算机学科、电子技术学科的数字逻辑、数字电路相关本科课程的实验教材，也可作为工程技术人员的参考书目。

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